科技网络公司纷纷布局 区块链“爆款”应用离我们还有多远？
向全球市场提供灵活、高度可配置、可定制的半导体设计知识产权（IP）和验证IP（VIP）的开发商SmartDV? Technologies自豪地宣布：公司现已提供即刻可用的H.264和H.265视频编码器和解码器IP解决方案。针对每一种技术，SmartDV都提供了所有三种配置的IP产品，包括H.264的基本配置（Baseline）、主流配置（Main）和高性能配置（High）版本，以及H.265的主流（Main）配置、主流10（Main 10）配置和主流静态图像（Main Still Picture）配置版
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SmartDV H.264 H.265 视频编码器 解码器IP
介绍了H.264的量化算法，并用Modelsim进行了仿真，结果与理论完全一致。分析了在FPGA开发板上的资源的消耗。由此可知，完全可以用FPGA实现H.264的量化
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Verilog 264 AVC
硬盘录像机(DVR)作为监控系统的核心部件之一，在10年里高速发展，从模拟磁带机的替代品演变成具有自己独特价值的专业监控数字平台，并被市场广泛接受。监控系统伴随DVR这些年的发展向着IP化、智能化发展。 根据行业用户的需求，DVR由以下几个方向需要被行业关注：1、DVR的编码方式向更高压缩效率的标准H.264发展;2、录像分辨率从CIF(352*288分辨率) 向D1(720*576)、720P、1080P发展;3、现场监控分辨率也从D1向HD高清发展;4、封闭子系统向开放IP架构系统发展
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H.264 Hi3520
硬盘录像机(DVR)作为监控系统的核心部件之一，在10年里高速发展，从模拟磁带机的替代品演变成具有自己独特价值的专业监控数字平台，并被市场广泛接受。监控系统伴随DVR这些年的发展向着IP化、智能化发展。 根据行业用户的需求，DVR由以下几个方向需要被行业关注：1、DVR的编码方式向更高压缩效率的标准H.264发展;2、录像分辨率从CIF(352*288分辨率) 向D1(720*576)、720P、1080P发展;3、现场监控分辨率也从D1向HD高清发展;4、封闭子系统向开放IP架构系统发展
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H.264 SoC
对于蓬勃发展的视频编解码市场，上游芯片厂家如TI、安霸等从未停止过竞争，国外厂家的技术与积累一直都处于领先地位，但是近年来，国内厂家如华为海思等也不断地在产业上游下功夫，在某些技术领域取得一定的领先地位，通过专利和技术突破构建市场堡垒，形成竞争优势。
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视频芯片 H.264
记得以前家中刚有影碟机的时候，虽然只能放DVD但却为那犹如电影院的感觉而痴迷。虽然以现在的眼光看那时的效果根本称不上影院级别，但当时带来的视觉冲击力却是不可否认的，正是从那个时候开始，培养了我对影视方面的兴趣。而自从掌上MP4风行后，便开始对在掌上看影片产生了浓厚的兴趣。
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MP4 H.264 DVD
随着NGN、3G及3G演进和NGBW等对视频、多媒体业务与网络应用的飞速发展需求，作为视频业务及存储应用核心技术的高效率 视频数字压缩编(译码)技术，愈来愈引起人们的关注，成为目前广播、视频与多媒体通信领域中的亮点与热点。
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H.264/AVC ITU-T 视频压缩
硬盘录像机(DVR)作为监控系统的核心部件之一，在10年里高速发展，从模拟磁带机的替代品演变成具有自己独特价值的专业监控数字平台，并被市场广泛接受。监控系统伴随DVR这些年的发展向着IP化、智能化发展.
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H.264 视频编解码 SoC 高清DVR设计
原来国际电信标准化部门从1998年就H.26L的H.26S两个分组，前者研制节目时间较长的高压缩编码技术，后者则指短节目标准制订部门。H.26S 的标准化技术的名称为H.263，听起来很耳生，但实质上却早在用了，还被骂得很激烈。因为，H.263先入为大，一直以MPEG-4大内涵的名字在用。 H.263的全称为MPEG-4 Visual或MPEG-4 Pall Ⅱ，即MPEG-4视频简单层面的基础编码方式。2001年后，国际电信标准化部门ITU-T和MPEG的上级组织国际标准化组织ISO/国际电气标准会议I
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H.264 德州仪器 MPEG-4
随着视频监控产品的规格化，ASIC 方案在成本和稳定性方面逐渐显露出优势，针对音视频压缩卡市场适时推出了FH8735 芯片。FH8735能够支持两路720P30 高清或者8 路D1 .
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FH8735 音视频压缩卡 H.264
本文从技术角度对MPEG-2的视频标准，MPEG-4AVC/H.264和AVS视频三个视频标准进行对比，包括技术方案，主观测食，客观测试，复杂度等四个方面。
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MPEG-2 MPEG-4 H.264 AVS
在对H．264标准中二进制化部分研究和分析的基础上，提出其FPGA电路结构，采用并行结构及流水线方式设计电路。该结构经Spartan3 FPGA实现，其吞吐量为每周期1 bit，最大时钟频率为100 MHz，能够满足H．264中第3级及其以上档次实时视频编码的要求。
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H.264 二进制化 编码器 FPGA
构建了面向H.264视频编码器的SoC验证平台，采用FPGA原型系统完成H.264编码器验证。采用Wishbone总线连接32位微处理器OR1200以及其他的必要IP核构建基本SoC平台，并在此基础上集成H.264硬件编码模块；根据H.264编码器的数据流要求，设计了逐行输入/宏块顺序输出的多端口SDRAM控制器；移植了μC/OSII实时
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H.264 视频编码器 SoC验证平台
h．264介绍
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