侄子是什么关系
- 对以往电子血压计的不足，介绍了一种基于可编程片上系统(SOPC)的智能电子血压计的设计，血压测量的方法采用基于充气过程的示波法。该系统采用Cyclone II系列低成本FPGA.
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SOPC 电子血压计 FPGA
- FPGA在复杂逻辑电路以及数字信号处理领域中扮演者越来越重要的角色，SOC（片上系统）以其低功耗，高性能，低成本，高可靠性等优点成为嵌入式系统的发展趋势。作为一个简明的教程，主要宗旨是让初学者快速地了解FPGA/SOPC（可编程片上系统）开发的流程。目前IT技术的发展可以说是一日千里，以本人的观点来讲，如果希望在电子设计领域有所作为，则必须具备快速掌握新技术的能力。
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SOPC FPGA 快速教程 开发板
- 现在的运动控制器已经发展到了以专用芯片(ASIC)或FPGA作为核心处理部件的开放式运动控制器。这样的解决方案突出的特点，是让运动控制的处理部分以独立的、硬件性方式展开，增加系统的性能和可靠性,从而有效地解决了以单纯的MCU或DSP系统的处理带宽限制，以及用户系统软件和运动控制软件混杂性的问题。
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SOPC 运动控制 芯片
- SOPC(System On Programmable Chip)即可编程的片上系统，或者说是基于大规模FPGA的单片系统。SOPC的设计技术是现代计算机辅助设计技术、EDA技术和大规模集成电路技术高度发展的产物。
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SOPC FPGA
- SOPC一词主要是源自Altera, 其涵义是因为目前CPLD/FPGA的容量愈來愈大, 性能愈來愈好, 加上价格下跌的推波助澜之下, 以往ASIC产品才能具有的 SoC观念, 也能移植到CPLD/FPGA上, 并且因为CPLD/FPGA的可编程(Programmable)能力, 使得CPLD/FPGA不仅能实现一个高复难度的系统, 而且还能快速改变系统的特性. 类似的观念也鉴于Xilinx的Platform FPGA.
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SOPC CPLD FPGA
- 介绍了等精度频率测量方法的原理及误差分析，利用基于FPGA的SoPC技术在QuartusⅡ5.0环境下用VHDL语言实现了等精度频率计的软核IP Core设计，并在相应的开发平台上作了验证。
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等精度频率测量 IPCore SOPC
- 为实现某专用接口装置的接口功能检测，文中详细地介绍了一种34位串行码的编码方式，并基于FPGA芯片设计了该类型编码的接收、发送电路。重点分析了电路各模块的设计思路。电路采用SOPC模块作为中心控制器，设计简洁、可靠。试验表明：该设计系统运行正常、稳定。
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串行编码 SOPC FPGA
- 结合SoPC及GPRS技术设计了一个以FPGA为核心的多用途无线监控报警系统。系统有多种工作模式，用户可随时主动监控现场，也可启用智能方式或手动方式报警。
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无线监控报警系统 SOPC GPRS
- 本人在教学及科研实验中，对基于μC/OS-II的多任务系统在SOPC中的设计总结出了具体实现方法。经过实践验证，该方法简单、可靠，值得推广。
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多任务系统 SOPC 实时操作系统
- 为了满足网络及多媒体领域的应用，JPEG2000的硬件实现具有重要意义。本文提出了一种改进的行式二维小波变换器结构，设计了位平面并行的位平面编码器和四级流水线结构的算术编码器，并将其整合于一个SOPC中，实现了JPEG2000编码系统。整个设计通过Altera公司Stratix II系列的EP2S60F1020C5平台验证，在最高时钟频率98MHz下能达到编码分辨率512*512 灰度图像52frame/s的速度，满足了实时编码的要求。
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JPEG SOPC 行式二维小波变换器
- 针对模型预测控制在微型设备及嵌入式系统应用中的实时性问题,从硬件实现控制算法的角度研究了基于FPGA（field programmable gate array）的预测控制器的设计和实现。采用基于Nios II嵌入式软核处理器的FPGA/SOPC（system on pro-grammable chip,可编程片上系统）方案,在FPGA芯片上构建SOPC系统,设计SOPC的硬件及软件系统,实现了基于FPGA的预测控制器;建立了基于FPGA和dSPACE系统的实时仿真平台,并进行了控制器实时仿真实验。实时
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模型预测控制 SOPC FPGA
- 利用SOPC强大的IP核和容易配置的优势简化设计流程。充分发挥NiosⅡ强大的并行处理能力。该系统主要涉及多个下位机与FPGA的通信问题。
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SOPC IP核 NiosII
- 在介绍以太网控制器DM9000A的数据帧收发过程的基础上，运用SOPC技术，设计了用DM9000A作为调制解调器与主机间数据接口的调制解调器实现方案，并详述了系统的软、硬件设计过程。该方案具有实现简单，调制方式易调整的优点。
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SOPC 调制解调器 双绞线传输
- 震动数据分析技术的不断提高要求速度更快、精度更高、功能更强、成本更低的数据采集系统。AD7329恰好满足这些要求，它集成了可编程输入范围切换矩阵、高精度基准源和高性能A/D转换单元于一体，而Nios Ⅱ嵌入式软核CPU具有数据吞吐率高、配置灵活、可升级性强等特点，是一款性价比很高的微控制器，结合两者并通过高速SPI总线进行通信，构成了高速、高精度震动信号采集设备。
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震动数据分析 SOPC NIOSⅡ
- 针对FPGA IP核在可进化可编程系统芯片(SoPC)中嵌入时存在FPGA IP核端口时序控制和位流下载的问题，实现一种适用于可进化SoPC芯片的FPGA接口。该FPGA接口使用异步FIFO、双口RAM的结构和可扩展的读/写命令传输方式来实现FPGA IP核与系统的异步通信。嵌入式CPU可以通过FPGA接口实现FPGA IP核的片内位流配置。FPGA接口中的硬件随机数发生器实现进化算法的硬件加速。
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IP核 SOPC 片内位流配置
片上可编程系统(sopc)介绍
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